git.rot13.org Git - DSO138/blob - Libraries/STM32F10x_StdPeriph_Driver/inc/stm32f10x_tim.h

   1 /**\r
   2   ******************************************************************************\r
   3   * @file    stm32f10x_tim.h\r
   4   * @author  MCD Application Team\r
   5   * @version V3.3.0\r
   6   * @date    04/16/2010\r
   7   * @brief   This file contains all the functions prototypes for the TIM firmware \r
   8   *          library.\r
   9   ******************************************************************************\r
  10   * @copy\r
  11   *\r
  12   * THE PRESENT FIRMWARE WHICH IS FOR GUIDANCE ONLY AIMS AT PROVIDING CUSTOMERS\r
  13   * WITH CODING INFORMATION REGARDING THEIR PRODUCTS IN ORDER FOR THEM TO SAVE\r
  14   * TIME. AS A RESULT, STMICROELECTRONICS SHALL NOT BE HELD LIABLE FOR ANY\r
  15   * DIRECT, INDIRECT OR CONSEQUENTIAL DAMAGES WITH RESPECT TO ANY CLAIMS ARISING\r
  16   * FROM THE CONTENT OF SUCH FIRMWARE AND/OR THE USE MADE BY CUSTOMERS OF THE\r
  17   * CODING INFORMATION CONTAINED HEREIN IN CONNECTION WITH THEIR PRODUCTS.\r
  18   *\r
  19   * <h2><center>&copy; COPYRIGHT 2010 STMicroelectronics</center></h2>\r
  20   */ \r
  21 \r
  22 /* Define to prevent recursive inclusion -------------------------------------*/\r
  23 #ifndef __STM32F10x_TIM_H\r
  24 #define __STM32F10x_TIM_H\r
  25 \r
  26 #ifdef __cplusplus\r
  27  extern "C" {\r
  28 #endif\r
  29 \r
  30 /* Includes ------------------------------------------------------------------*/\r
  31 #include "stm32f10x.h"\r
  32 \r
  33 /** @addtogroup STM32F10x_StdPeriph_Driver\r
  34   * @{\r
  35   */\r
  36 \r
  37 /** @addtogroup TIM\r
  38   * @{\r
  39   */ \r
  40 \r
  41 /** @defgroup TIM_Exported_Types\r
  42   * @{\r
  43   */ \r
  44 \r
  45 /** \r
  46   * @brief  TIM Time Base Init structure definition\r
  47   * @note   This sturcture is used with all TIMx except for TIM6 and TIM7.    \r
  48   */\r
  49 \r
  50 typedef struct\r
  51 {\r
  52   uint16_t TIM_Prescaler;         /*!< Specifies the prescaler value used to divide the TIM clock.\r
  53                                        This parameter can be a number between 0x0000 and 0xFFFF */\r
  54 \r
  55   uint16_t TIM_CounterMode;       /*!< Specifies the counter mode.\r
  56                                        This parameter can be a value of @ref TIM_Counter_Mode */\r
  57 \r
  58   uint16_t TIM_Period;            /*!< Specifies the period value to be loaded into the active\r
  59                                        Auto-Reload Register at the next update event.\r
  60                                        This parameter must be a number between 0x0000 and 0xFFFF.  */ \r
  61 \r
  62   uint16_t TIM_ClockDivision;     /*!< Specifies the clock division.\r
  63                                       This parameter can be a value of @ref TIM_Clock_Division_CKD */\r
  64 \r
  65   uint8_t TIM_RepetitionCounter;  /*!< Specifies the repetition counter value. Each time the RCR downcounter\r
  66                                        reaches zero, an update event is generated and counting restarts\r
  67                                        from the RCR value (N).\r
  68                                        This means in PWM mode that (N+1) corresponds to:\r
  69                                           - the number of PWM periods in edge-aligned mode\r
  70                                           - the number of half PWM period in center-aligned mode\r
  71                                        This parameter must be a number between 0x00 and 0xFF. \r
  72                                        @note This parameter is valid only for TIM1 and TIM8. */\r
  73 } TIM_TimeBaseInitTypeDef;       \r
  74 \r
  75 /** \r
  76   * @brief  TIM Output Compare Init structure definition  \r
  77   */\r
  78 \r
  79 typedef struct\r
  80 {\r
  81   uint16_t TIM_OCMode;        /*!< Specifies the TIM mode.\r
  82                                    This parameter can be a value of @ref TIM_Output_Compare_and_PWM_modes */\r
  83 \r
  84   uint16_t TIM_OutputState;   /*!< Specifies the TIM Output Compare state.\r
  85                                    This parameter can be a value of @ref TIM_Output_Compare_state */\r
  86 \r
  87   uint16_t TIM_OutputNState;  /*!< Specifies the TIM complementary Output Compare state.\r
  88                                    This parameter can be a value of @ref TIM_Output_Compare_N_state\r
  89                                    @note This parameter is valid only for TIM1 and TIM8. */\r
  90 \r
  91   uint16_t TIM_Pulse;         /*!< Specifies the pulse value to be loaded into the Capture Compare Register. \r
  92                                    This parameter can be a number between 0x0000 and 0xFFFF */\r
  93 \r
  94   uint16_t TIM_OCPolarity;    /*!< Specifies the output polarity.\r
  95                                    This parameter can be a value of @ref TIM_Output_Compare_Polarity */\r
  96 \r
  97   uint16_t TIM_OCNPolarity;   /*!< Specifies the complementary output polarity.\r
  98                                    This parameter can be a value of @ref TIM_Output_Compare_N_Polarity\r
  99                                    @note This parameter is valid only for TIM1 and TIM8. */\r
 100 \r
 101   uint16_t TIM_OCIdleState;   /*!< Specifies the TIM Output Compare pin state during Idle state.\r
 102                                    This parameter can be a value of @ref TIM_Output_Compare_Idle_State\r
 103                                    @note This parameter is valid only for TIM1 and TIM8. */\r
 104 \r
 105   uint16_t TIM_OCNIdleState;  /*!< Specifies the TIM Output Compare pin state during Idle state.\r
 106                                    This parameter can be a value of @ref TIM_Output_Compare_N_Idle_State\r
 107                                    @note This parameter is valid only for TIM1 and TIM8. */\r
 108 } TIM_OCInitTypeDef;\r
 109 \r
 110 /** \r
 111   * @brief  TIM Input Capture Init structure definition  \r
 112   */\r
 113 \r
 114 typedef struct\r
 115 {\r
 116 \r
 117   uint16_t TIM_Channel;      /*!< Specifies the TIM channel.\r
 118                                   This parameter can be a value of @ref TIM_Channel */\r
 119 \r
 120   uint16_t TIM_ICPolarity;   /*!< Specifies the active edge of the input signal.\r
 121                                   This parameter can be a value of @ref TIM_Input_Capture_Polarity */\r
 122 \r
 123   uint16_t TIM_ICSelection;  /*!< Specifies the input.\r
 124                                   This parameter can be a value of @ref TIM_Input_Capture_Selection */\r
 125 \r
 126   uint16_t TIM_ICPrescaler;  /*!< Specifies the Input Capture Prescaler.\r
 127                                   This parameter can be a value of @ref TIM_Input_Capture_Prescaler */\r
 128 \r
 129   uint16_t TIM_ICFilter;     /*!< Specifies the input capture filter.\r
 130                                   This parameter can be a number between 0x0 and 0xF */\r
 131 } TIM_ICInitTypeDef;\r
 132 \r
 133 /** \r
 134   * @brief  BDTR structure definition \r
 135   * @note   This sturcture is used only with TIM1 and TIM8.    \r
 136   */\r
 137 \r
 138 typedef struct\r
 139 {\r
 140 \r
 141   uint16_t TIM_OSSRState;        /*!< Specifies the Off-State selection used in Run mode.\r
 142                                       This parameter can be a value of @ref OSSR_Off_State_Selection_for_Run_mode_state */\r
 143 \r
 144   uint16_t TIM_OSSIState;        /*!< Specifies the Off-State used in Idle state.\r
 145                                       This parameter can be a value of @ref OSSI_Off_State_Selection_for_Idle_mode_state */\r
 146 \r
 147   uint16_t TIM_LOCKLevel;        /*!< Specifies the LOCK level parameters.\r
 148                                       This parameter can be a value of @ref Lock_level */ \r
 149 \r
 150   uint16_t TIM_DeadTime;         /*!< Specifies the delay time between the switching-off and the\r
 151                                       switching-on of the outputs.\r
 152                                       This parameter can be a number between 0x00 and 0xFF  */\r
 153 \r
 154   uint16_t TIM_Break;            /*!< Specifies whether the TIM Break input is enabled or not. \r
 155                                       This parameter can be a value of @ref Break_Input_enable_disable */\r
 156 \r
 157   uint16_t TIM_BreakPolarity;    /*!< Specifies the TIM Break Input pin polarity.\r
 158                                       This parameter can be a value of @ref Break_Polarity */\r
 159 \r
 160   uint16_t TIM_AutomaticOutput;  /*!< Specifies whether the TIM Automatic Output feature is enabled or not. \r
 161                                       This parameter can be a value of @ref TIM_AOE_Bit_Set_Reset */\r
 162 } TIM_BDTRInitTypeDef;\r
 163 \r
 164 /** @defgroup TIM_Exported_constants \r
 165   * @{\r
 166   */\r
 167 \r
 168 #define IS_TIM_ALL_PERIPH(PERIPH) (((PERIPH) == TIM1) || \\r
 169                                    ((PERIPH) == TIM2) || \\r
 170                                    ((PERIPH) == TIM3) || \\r
 171                                    ((PERIPH) == TIM4) || \\r
 172                                    ((PERIPH) == TIM5) || \\r
 173                                    ((PERIPH) == TIM6) || \\r
 174                                    ((PERIPH) == TIM7) || \\r
 175                                    ((PERIPH) == TIM8) || \\r
 176                                    ((PERIPH) == TIM9) || \\r
 177                                    ((PERIPH) == TIM10)|| \\r
 178                                    ((PERIPH) == TIM11)|| \\r
 179                                    ((PERIPH) == TIM12)|| \\r
 180                                    ((PERIPH) == TIM13)|| \\r
 181                                    ((PERIPH) == TIM14)|| \\r
 182                                    ((PERIPH) == TIM15)|| \\r
 183                                    ((PERIPH) == TIM16)|| \\r
 184                                    ((PERIPH) == TIM17))\r
 185 \r
 186 /* LIST1: TIM 1 and 8 */\r
 187 #define IS_TIM_LIST1_PERIPH(PERIPH)  (((PERIPH) == TIM1) || \\r
 188                                       ((PERIPH) == TIM8))\r
 189 \r
 190 /* LIST2: TIM 1, 8, 15 16 and 17 */\r
 191 #define IS_TIM_LIST2_PERIPH(PERIPH) (((PERIPH) == TIM1) || \\r
 192                                      ((PERIPH) == TIM8) || \\r
 193                                      ((PERIPH) == TIM15)|| \\r
 194                                      ((PERIPH) == TIM16)|| \\r
 195                                      ((PERIPH) == TIM17)) \r
 196 \r
 197 /* LIST3: TIM 1, 2, 3, 4, 5 and 8 */\r
 198 #define IS_TIM_LIST3_PERIPH(PERIPH) (((PERIPH) == TIM1) || \\r
 199                                      ((PERIPH) == TIM2) || \\r
 200                                      ((PERIPH) == TIM3) || \\r
 201                                      ((PERIPH) == TIM4) || \\r
 202                                      ((PERIPH) == TIM5) || \\r
 203                                      ((PERIPH) == TIM8)) \r
 204                                                                                                          \r
 205 /* LIST4: TIM 1, 2, 3, 4, 5, 8, 15, 16 and 17 */\r
 206 #define IS_TIM_LIST4_PERIPH(PERIPH) (((PERIPH) == TIM1) || \\r
 207                                      ((PERIPH) == TIM2) || \\r
 208                                      ((PERIPH) == TIM3) || \\r
 209                                      ((PERIPH) == TIM4) || \\r
 210                                      ((PERIPH) == TIM5) || \\r
 211                                      ((PERIPH) == TIM8) || \\r
 212                                      ((PERIPH) == TIM15)|| \\r
 213                                      ((PERIPH) == TIM16)|| \\r
 214                                      ((PERIPH) == TIM17))\r
 215 \r
 216 /* LIST5: TIM 1, 2, 3, 4, 5, 8 and 15 */                                            \r
 217 #define IS_TIM_LIST5_PERIPH(PERIPH) (((PERIPH) == TIM1) || \\r
 218                                      ((PERIPH) == TIM2) || \\r
 219                                      ((PERIPH) == TIM3) || \\r
 220                                      ((PERIPH) == TIM4) || \\r
 221                                      ((PERIPH) == TIM5) || \\r
 222                                      ((PERIPH) == TIM8) || \\r
 223                                      ((PERIPH) == TIM15)) \r
 224 \r
 225 /* LIST6: TIM 1, 2, 3, 4, 5, 8, 9, 12 and 15 */\r
 226 #define IS_TIM_LIST6_PERIPH(PERIPH)  (((PERIPH) == TIM1) || \\r
 227                                       ((PERIPH) == TIM2) || \\r
 228                                       ((PERIPH) == TIM3) || \\r
 229                                       ((PERIPH) == TIM4) || \\r
 230                                       ((PERIPH) == TIM5) || \\r
 231                                       ((PERIPH) == TIM8) || \\r
 232                                       ((PERIPH) == TIM9) || \\r
 233                                                                           ((PERIPH) == TIM12)|| \\r
 234                                       ((PERIPH) == TIM15))\r
 235 \r
 236 /* LIST7: TIM 1, 2, 3, 4, 5, 6, 7, 8, 9, 12 and 15 */\r
 237 #define IS_TIM_LIST7_PERIPH(PERIPH)  (((PERIPH) == TIM1) || \\r
 238                                       ((PERIPH) == TIM2) || \\r
 239                                       ((PERIPH) == TIM3) || \\r
 240                                       ((PERIPH) == TIM4) || \\r
 241                                       ((PERIPH) == TIM5) || \\r
 242                                       ((PERIPH) == TIM6) || \\r
 243                                       ((PERIPH) == TIM7) || \\r
 244                                       ((PERIPH) == TIM8) || \\r
 245                                       ((PERIPH) == TIM9) || \\r
 246                                       ((PERIPH) == TIM12)|| \\r
 247                                       ((PERIPH) == TIM15))                                    \r
 248 \r
 249 /* LIST8: TIM 1, 2, 3, 4, 5, 8, 9, 10, 11, 12, 13, 14, 15, 16 and 17 */                                        \r
 250 #define IS_TIM_LIST8_PERIPH(PERIPH)  (((PERIPH) == TIM1) || \\r
 251                                       ((PERIPH) == TIM2) || \\r
 252                                       ((PERIPH) == TIM3) || \\r
 253                                       ((PERIPH) == TIM4) || \\r
 254                                       ((PERIPH) == TIM5) || \\r
 255                                       ((PERIPH) == TIM8) || \\r
 256                                       ((PERIPH) == TIM9) || \\r
 257                                       ((PERIPH) == TIM10)|| \\r
 258                                       ((PERIPH) == TIM11)|| \\r
 259                                       ((PERIPH) == TIM12)|| \\r
 260                                       ((PERIPH) == TIM13)|| \\r
 261                                       ((PERIPH) == TIM14)|| \\r
 262                                       ((PERIPH) == TIM15)|| \\r
 263                                       ((PERIPH) == TIM16)|| \\r
 264                                       ((PERIPH) == TIM17))\r
 265 \r
 266 /* LIST9: TIM 1, 2, 3, 4, 5, 6, 7, 8, 15, 16, and 17 */\r
 267 #define IS_TIM_LIST9_PERIPH(PERIPH)  (((PERIPH) == TIM1) || \\r
 268                                       ((PERIPH) == TIM2) || \\r
 269                                       ((PERIPH) == TIM3) || \\r
 270                                       ((PERIPH) == TIM4) || \\r
 271                                       ((PERIPH) == TIM5) || \\r
 272                                       ((PERIPH) == TIM6) || \\r
 273                                       ((PERIPH) == TIM7) || \\r
 274                                       ((PERIPH) == TIM8) || \\r
 275                                       ((PERIPH) == TIM15)|| \\r
 276                                       ((PERIPH) == TIM16)|| \\r
 277                                       ((PERIPH) == TIM17))  \r
 278                                                                                                                                                                                                                           \r
 279 /**\r
 280   * @}\r
 281   */ \r
 282 \r
 283 /** @defgroup TIM_Output_Compare_and_PWM_modes \r
 284   * @{\r
 285   */\r
 286 \r
 287 #define TIM_OCMode_Timing                  ((uint16_t)0x0000)\r
 288 #define TIM_OCMode_Active                  ((uint16_t)0x0010)\r
 289 #define TIM_OCMode_Inactive                ((uint16_t)0x0020)\r
 290 #define TIM_OCMode_Toggle                  ((uint16_t)0x0030)\r
 291 #define TIM_OCMode_PWM1                    ((uint16_t)0x0060)\r
 292 #define TIM_OCMode_PWM2                    ((uint16_t)0x0070)\r
 293 #define IS_TIM_OC_MODE(MODE) (((MODE) == TIM_OCMode_Timing) || \\r
 294                               ((MODE) == TIM_OCMode_Active) || \\r
 295                               ((MODE) == TIM_OCMode_Inactive) || \\r
 296                               ((MODE) == TIM_OCMode_Toggle)|| \\r
 297                               ((MODE) == TIM_OCMode_PWM1) || \\r
 298                               ((MODE) == TIM_OCMode_PWM2))\r
 299 #define IS_TIM_OCM(MODE) (((MODE) == TIM_OCMode_Timing) || \\r
 300                           ((MODE) == TIM_OCMode_Active) || \\r
 301                           ((MODE) == TIM_OCMode_Inactive) || \\r
 302                           ((MODE) == TIM_OCMode_Toggle)|| \\r
 303                           ((MODE) == TIM_OCMode_PWM1) || \\r
 304                           ((MODE) == TIM_OCMode_PWM2) ||        \\r
 305                           ((MODE) == TIM_ForcedAction_Active) || \\r
 306                           ((MODE) == TIM_ForcedAction_InActive))\r
 307 /**\r
 308   * @}\r
 309   */\r
 310 \r
 311 /** @defgroup TIM_One_Pulse_Mode \r
 312   * @{\r
 313   */\r
 314 \r
 315 #define TIM_OPMode_Single                  ((uint16_t)0x0008)\r
 316 #define TIM_OPMode_Repetitive              ((uint16_t)0x0000)\r
 317 #define IS_TIM_OPM_MODE(MODE) (((MODE) == TIM_OPMode_Single) || \\r
 318                                ((MODE) == TIM_OPMode_Repetitive))\r
 319 /**\r
 320   * @}\r
 321   */ \r
 322 \r
 323 /** @defgroup TIM_Channel \r
 324   * @{\r
 325   */\r
 326 \r
 327 #define TIM_Channel_1                      ((uint16_t)0x0000)\r
 328 #define TIM_Channel_2                      ((uint16_t)0x0004)\r
 329 #define TIM_Channel_3                      ((uint16_t)0x0008)\r
 330 #define TIM_Channel_4                      ((uint16_t)0x000C)\r
 331 #define IS_TIM_CHANNEL(CHANNEL) (((CHANNEL) == TIM_Channel_1) || \\r
 332                                  ((CHANNEL) == TIM_Channel_2) || \\r
 333                                  ((CHANNEL) == TIM_Channel_3) || \\r
 334                                  ((CHANNEL) == TIM_Channel_4))\r
 335 #define IS_TIM_PWMI_CHANNEL(CHANNEL) (((CHANNEL) == TIM_Channel_1) || \\r
 336                                       ((CHANNEL) == TIM_Channel_2))\r
 337 #define IS_TIM_COMPLEMENTARY_CHANNEL(CHANNEL) (((CHANNEL) == TIM_Channel_1) || \\r
 338                                                ((CHANNEL) == TIM_Channel_2) || \\r
 339                                                ((CHANNEL) == TIM_Channel_3))\r
 340 /**\r
 341   * @}\r
 342   */ \r
 343 \r
 344 /** @defgroup TIM_Clock_Division_CKD \r
 345   * @{\r
 346   */\r
 347 \r
 348 #define TIM_CKD_DIV1                       ((uint16_t)0x0000)\r
 349 #define TIM_CKD_DIV2                       ((uint16_t)0x0100)\r
 350 #define TIM_CKD_DIV4                       ((uint16_t)0x0200)\r
 351 #define IS_TIM_CKD_DIV(DIV) (((DIV) == TIM_CKD_DIV1) || \\r
 352                              ((DIV) == TIM_CKD_DIV2) || \\r
 353                              ((DIV) == TIM_CKD_DIV4))\r
 354 /**\r
 355   * @}\r
 356   */\r
 357 \r
 358 /** @defgroup TIM_Counter_Mode \r
 359   * @{\r
 360   */\r
 361 \r
 362 #define TIM_CounterMode_Up                 ((uint16_t)0x0000)\r
 363 #define TIM_CounterMode_Down               ((uint16_t)0x0010)\r
 364 #define TIM_CounterMode_CenterAligned1     ((uint16_t)0x0020)\r
 365 #define TIM_CounterMode_CenterAligned2     ((uint16_t)0x0040)\r
 366 #define TIM_CounterMode_CenterAligned3     ((uint16_t)0x0060)\r
 367 #define IS_TIM_COUNTER_MODE(MODE) (((MODE) == TIM_CounterMode_Up) ||  \\r
 368                                    ((MODE) == TIM_CounterMode_Down) || \\r
 369                                    ((MODE) == TIM_CounterMode_CenterAligned1) || \\r
 370                                    ((MODE) == TIM_CounterMode_CenterAligned2) || \\r
 371                                    ((MODE) == TIM_CounterMode_CenterAligned3))\r
 372 /**\r
 373   * @}\r
 374   */ \r
 375 \r
 376 /** @defgroup TIM_Output_Compare_Polarity \r
 377   * @{\r
 378   */\r
 379 \r
 380 #define TIM_OCPolarity_High                ((uint16_t)0x0000)\r
 381 #define TIM_OCPolarity_Low                 ((uint16_t)0x0002)\r
 382 #define IS_TIM_OC_POLARITY(POLARITY) (((POLARITY) == TIM_OCPolarity_High) || \\r
 383                                       ((POLARITY) == TIM_OCPolarity_Low))\r
 384 /**\r
 385   * @}\r
 386   */\r
 387 \r
 388 /** @defgroup TIM_Output_Compare_N_Polarity \r
 389   * @{\r
 390   */\r
 391   \r
 392 #define TIM_OCNPolarity_High               ((uint16_t)0x0000)\r
 393 #define TIM_OCNPolarity_Low                ((uint16_t)0x0008)\r
 394 #define IS_TIM_OCN_POLARITY(POLARITY) (((POLARITY) == TIM_OCNPolarity_High) || \\r
 395                                        ((POLARITY) == TIM_OCNPolarity_Low))\r
 396 /**\r
 397   * @}\r
 398   */\r
 399 \r
 400 /** @defgroup TIM_Output_Compare_state \r
 401   * @{\r
 402   */\r
 403 \r
 404 #define TIM_OutputState_Disable            ((uint16_t)0x0000)\r
 405 #define TIM_OutputState_Enable             ((uint16_t)0x0001)\r
 406 #define IS_TIM_OUTPUT_STATE(STATE) (((STATE) == TIM_OutputState_Disable) || \\r
 407                                     ((STATE) == TIM_OutputState_Enable))\r
 408 /**\r
 409   * @}\r
 410   */ \r
 411 \r
 412 /** @defgroup TIM_Output_Compare_N_state \r
 413   * @{\r
 414   */\r
 415 \r
 416 #define TIM_OutputNState_Disable           ((uint16_t)0x0000)\r
 417 #define TIM_OutputNState_Enable            ((uint16_t)0x0004)\r
 418 #define IS_TIM_OUTPUTN_STATE(STATE) (((STATE) == TIM_OutputNState_Disable) || \\r
 419                                      ((STATE) == TIM_OutputNState_Enable))\r
 420 /**\r
 421   * @}\r
 422   */ \r
 423 \r
 424 /** @defgroup TIM_Capture_Compare_state \r
 425   * @{\r
 426   */\r
 427 \r
 428 #define TIM_CCx_Enable                      ((uint16_t)0x0001)\r
 429 #define TIM_CCx_Disable                     ((uint16_t)0x0000)\r
 430 #define IS_TIM_CCX(CCX) (((CCX) == TIM_CCx_Enable) || \\r
 431                          ((CCX) == TIM_CCx_Disable))\r
 432 /**\r
 433   * @}\r
 434   */ \r
 435 \r
 436 /** @defgroup TIM_Capture_Compare_N_state \r
 437   * @{\r
 438   */\r
 439 \r
 440 #define TIM_CCxN_Enable                     ((uint16_t)0x0004)\r
 441 #define TIM_CCxN_Disable                    ((uint16_t)0x0000)\r
 442 #define IS_TIM_CCXN(CCXN) (((CCXN) == TIM_CCxN_Enable) || \\r
 443                            ((CCXN) == TIM_CCxN_Disable))\r
 444 /**\r
 445   * @}\r
 446   */ \r
 447 \r
 448 /** @defgroup Break_Input_enable_disable \r
 449   * @{\r
 450   */\r
 451 \r
 452 #define TIM_Break_Enable                   ((uint16_t)0x1000)\r
 453 #define TIM_Break_Disable                  ((uint16_t)0x0000)\r
 454 #define IS_TIM_BREAK_STATE(STATE) (((STATE) == TIM_Break_Enable) || \\r
 455                                    ((STATE) == TIM_Break_Disable))\r
 456 /**\r
 457   * @}\r
 458   */ \r
 459 \r
 460 /** @defgroup Break_Polarity \r
 461   * @{\r
 462   */\r
 463 \r
 464 #define TIM_BreakPolarity_Low              ((uint16_t)0x0000)\r
 465 #define TIM_BreakPolarity_High             ((uint16_t)0x2000)\r
 466 #define IS_TIM_BREAK_POLARITY(POLARITY) (((POLARITY) == TIM_BreakPolarity_Low) || \\r
 467                                          ((POLARITY) == TIM_BreakPolarity_High))\r
 468 /**\r
 469   * @}\r
 470   */ \r
 471 \r
 472 /** @defgroup TIM_AOE_Bit_Set_Reset \r
 473   * @{\r
 474   */\r
 475 \r
 476 #define TIM_AutomaticOutput_Enable         ((uint16_t)0x4000)\r
 477 #define TIM_AutomaticOutput_Disable        ((uint16_t)0x0000)\r
 478 #define IS_TIM_AUTOMATIC_OUTPUT_STATE(STATE) (((STATE) == TIM_AutomaticOutput_Enable) || \\r
 479                                               ((STATE) == TIM_AutomaticOutput_Disable))\r
 480 /**\r
 481   * @}\r
 482   */ \r
 483 \r
 484 /** @defgroup Lock_level \r
 485   * @{\r
 486   */\r
 487 \r
 488 #define TIM_LOCKLevel_OFF                  ((uint16_t)0x0000)\r
 489 #define TIM_LOCKLevel_1                    ((uint16_t)0x0100)\r
 490 #define TIM_LOCKLevel_2                    ((uint16_t)0x0200)\r
 491 #define TIM_LOCKLevel_3                    ((uint16_t)0x0300)\r
 492 #define IS_TIM_LOCK_LEVEL(LEVEL) (((LEVEL) == TIM_LOCKLevel_OFF) || \\r
 493                                   ((LEVEL) == TIM_LOCKLevel_1) || \\r
 494                                   ((LEVEL) == TIM_LOCKLevel_2) || \\r
 495                                   ((LEVEL) == TIM_LOCKLevel_3))\r
 496 /**\r
 497   * @}\r
 498   */ \r
 499 \r
 500 /** @defgroup OSSI_Off_State_Selection_for_Idle_mode_state \r
 501   * @{\r
 502   */\r
 503 \r
 504 #define TIM_OSSIState_Enable               ((uint16_t)0x0400)\r
 505 #define TIM_OSSIState_Disable              ((uint16_t)0x0000)\r
 506 #define IS_TIM_OSSI_STATE(STATE) (((STATE) == TIM_OSSIState_Enable) || \\r
 507                                   ((STATE) == TIM_OSSIState_Disable))\r
 508 /**\r
 509   * @}\r
 510   */\r
 511 \r
 512 /** @defgroup OSSR_Off_State_Selection_for_Run_mode_state \r
 513   * @{\r
 514   */\r
 515 \r
 516 #define TIM_OSSRState_Enable               ((uint16_t)0x0800)\r
 517 #define TIM_OSSRState_Disable              ((uint16_t)0x0000)\r
 518 #define IS_TIM_OSSR_STATE(STATE) (((STATE) == TIM_OSSRState_Enable) || \\r
 519                                   ((STATE) == TIM_OSSRState_Disable))\r
 520 /**\r
 521   * @}\r
 522   */ \r
 523 \r
 524 /** @defgroup TIM_Output_Compare_Idle_State \r
 525   * @{\r
 526   */\r
 527 \r
 528 #define TIM_OCIdleState_Set                ((uint16_t)0x0100)\r
 529 #define TIM_OCIdleState_Reset              ((uint16_t)0x0000)\r
 530 #define IS_TIM_OCIDLE_STATE(STATE) (((STATE) == TIM_OCIdleState_Set) || \\r
 531                                     ((STATE) == TIM_OCIdleState_Reset))\r
 532 /**\r
 533   * @}\r
 534   */ \r
 535 \r
 536 /** @defgroup TIM_Output_Compare_N_Idle_State \r
 537   * @{\r
 538   */\r
 539 \r
 540 #define TIM_OCNIdleState_Set               ((uint16_t)0x0200)\r
 541 #define TIM_OCNIdleState_Reset             ((uint16_t)0x0000)\r
 542 #define IS_TIM_OCNIDLE_STATE(STATE) (((STATE) == TIM_OCNIdleState_Set) || \\r
 543                                      ((STATE) == TIM_OCNIdleState_Reset))\r
 544 /**\r
 545   * @}\r
 546   */ \r
 547 \r
 548 /** @defgroup TIM_Input_Capture_Polarity \r
 549   * @{\r
 550   */\r
 551 \r
 552 #define  TIM_ICPolarity_Rising             ((uint16_t)0x0000)\r
 553 #define  TIM_ICPolarity_Falling            ((uint16_t)0x0002)\r
 554 #define IS_TIM_IC_POLARITY(POLARITY) (((POLARITY) == TIM_ICPolarity_Rising) || \\r
 555                                       ((POLARITY) == TIM_ICPolarity_Falling))\r
 556 /**\r
 557   * @}\r
 558   */ \r
 559 \r
 560 /** @defgroup TIM_Input_Capture_Selection \r
 561   * @{\r
 562   */\r
 563 \r
 564 #define TIM_ICSelection_DirectTI           ((uint16_t)0x0001) /*!< TIM Input 1, 2, 3 or 4 is selected to be \r
 565                                                                    connected to IC1, IC2, IC3 or IC4, respectively */\r
 566 #define TIM_ICSelection_IndirectTI         ((uint16_t)0x0002) /*!< TIM Input 1, 2, 3 or 4 is selected to be\r
 567                                                                    connected to IC2, IC1, IC4 or IC3, respectively. */\r
 568 #define TIM_ICSelection_TRC                ((uint16_t)0x0003) /*!< TIM Input 1, 2, 3 or 4 is selected to be connected to TRC. */\r
 569 #define IS_TIM_IC_SELECTION(SELECTION) (((SELECTION) == TIM_ICSelection_DirectTI) || \\r
 570                                         ((SELECTION) == TIM_ICSelection_IndirectTI) || \\r
 571                                         ((SELECTION) == TIM_ICSelection_TRC))\r
 572 /**\r
 573   * @}\r
 574   */ \r
 575 \r
 576 /** @defgroup TIM_Input_Capture_Prescaler \r
 577   * @{\r
 578   */\r
 579 \r
 580 #define TIM_ICPSC_DIV1                     ((uint16_t)0x0000) /*!< Capture performed each time an edge is detected on the capture input. */\r
 581 #define TIM_ICPSC_DIV2                     ((uint16_t)0x0004) /*!< Capture performed once every 2 events. */\r
 582 #define TIM_ICPSC_DIV4                     ((uint16_t)0x0008) /*!< Capture performed once every 4 events. */\r
 583 #define TIM_ICPSC_DIV8                     ((uint16_t)0x000C) /*!< Capture performed once every 8 events. */\r
 584 #define IS_TIM_IC_PRESCALER(PRESCALER) (((PRESCALER) == TIM_ICPSC_DIV1) || \\r
 585                                         ((PRESCALER) == TIM_ICPSC_DIV2) || \\r
 586                                         ((PRESCALER) == TIM_ICPSC_DIV4) || \\r
 587                                         ((PRESCALER) == TIM_ICPSC_DIV8))\r
 588 /**\r
 589   * @}\r
 590   */ \r
 591 \r
 592 /** @defgroup TIM_interrupt_sources \r
 593   * @{\r
 594   */\r
 595 \r
 596 #define TIM_IT_Update                      ((uint16_t)0x0001)\r
 597 #define TIM_IT_CC1                         ((uint16_t)0x0002)\r
 598 #define TIM_IT_CC2                         ((uint16_t)0x0004)\r
 599 #define TIM_IT_CC3                         ((uint16_t)0x0008)\r
 600 #define TIM_IT_CC4                         ((uint16_t)0x0010)\r
 601 #define TIM_IT_COM                         ((uint16_t)0x0020)\r
 602 #define TIM_IT_Trigger                     ((uint16_t)0x0040)\r
 603 #define TIM_IT_Break                       ((uint16_t)0x0080)\r
 604 #define IS_TIM_IT(IT) ((((IT) & (uint16_t)0xFF00) == 0x0000) && ((IT) != 0x0000))\r
 605 \r
 606 #define IS_TIM_GET_IT(IT) (((IT) == TIM_IT_Update) || \\r
 607                            ((IT) == TIM_IT_CC1) || \\r
 608                            ((IT) == TIM_IT_CC2) || \\r
 609                            ((IT) == TIM_IT_CC3) || \\r
 610                            ((IT) == TIM_IT_CC4) || \\r
 611                            ((IT) == TIM_IT_COM) || \\r
 612                            ((IT) == TIM_IT_Trigger) || \\r
 613                            ((IT) == TIM_IT_Break))\r
 614 /**\r
 615   * @}\r
 616   */ \r
 617 \r
 618 /** @defgroup TIM_DMA_Base_address \r
 619   * @{\r
 620   */\r
 621 \r
 622 #define TIM_DMABase_CR1                    ((uint16_t)0x0000)\r
 623 #define TIM_DMABase_CR2                    ((uint16_t)0x0001)\r
 624 #define TIM_DMABase_SMCR                   ((uint16_t)0x0002)\r
 625 #define TIM_DMABase_DIER                   ((uint16_t)0x0003)\r
 626 #define TIM_DMABase_SR                     ((uint16_t)0x0004)\r
 627 #define TIM_DMABase_EGR                    ((uint16_t)0x0005)\r
 628 #define TIM_DMABase_CCMR1                  ((uint16_t)0x0006)\r
 629 #define TIM_DMABase_CCMR2                  ((uint16_t)0x0007)\r
 630 #define TIM_DMABase_CCER                   ((uint16_t)0x0008)\r
 631 #define TIM_DMABase_CNT                    ((uint16_t)0x0009)\r
 632 #define TIM_DMABase_PSC                    ((uint16_t)0x000A)\r
 633 #define TIM_DMABase_ARR                    ((uint16_t)0x000B)\r
 634 #define TIM_DMABase_RCR                    ((uint16_t)0x000C)\r
 635 #define TIM_DMABase_CCR1                   ((uint16_t)0x000D)\r
 636 #define TIM_DMABase_CCR2                   ((uint16_t)0x000E)\r
 637 #define TIM_DMABase_CCR3                   ((uint16_t)0x000F)\r
 638 #define TIM_DMABase_CCR4                   ((uint16_t)0x0010)\r
 639 #define TIM_DMABase_BDTR                   ((uint16_t)0x0011)\r
 640 #define TIM_DMABase_DCR                    ((uint16_t)0x0012)\r
 641 #define IS_TIM_DMA_BASE(BASE) (((BASE) == TIM_DMABase_CR1) || \\r
 642                                ((BASE) == TIM_DMABase_CR2) || \\r
 643                                ((BASE) == TIM_DMABase_SMCR) || \\r
 644                                ((BASE) == TIM_DMABase_DIER) || \\r
 645                                ((BASE) == TIM_DMABase_SR) || \\r
 646                                ((BASE) == TIM_DMABase_EGR) || \\r
 647                                ((BASE) == TIM_DMABase_CCMR1) || \\r
 648                                ((BASE) == TIM_DMABase_CCMR2) || \\r
 649                                ((BASE) == TIM_DMABase_CCER) || \\r
 650                                ((BASE) == TIM_DMABase_CNT) || \\r
 651                                ((BASE) == TIM_DMABase_PSC) || \\r
 652                                ((BASE) == TIM_DMABase_ARR) || \\r
 653                                ((BASE) == TIM_DMABase_RCR) || \\r
 654                                ((BASE) == TIM_DMABase_CCR1) || \\r
 655                                ((BASE) == TIM_DMABase_CCR2) || \\r
 656                                ((BASE) == TIM_DMABase_CCR3) || \\r
 657                                ((BASE) == TIM_DMABase_CCR4) || \\r
 658                                ((BASE) == TIM_DMABase_BDTR) || \\r
 659                                ((BASE) == TIM_DMABase_DCR))\r
 660 /**\r
 661   * @}\r
 662   */ \r
 663 \r
 664 /** @defgroup TIM_DMA_Burst_Length \r
 665   * @{\r
 666   */\r
 667 \r
 668 #define TIM_DMABurstLength_1Byte           ((uint16_t)0x0000)\r
 669 #define TIM_DMABurstLength_2Bytes          ((uint16_t)0x0100)\r
 670 #define TIM_DMABurstLength_3Bytes          ((uint16_t)0x0200)\r
 671 #define TIM_DMABurstLength_4Bytes          ((uint16_t)0x0300)\r
 672 #define TIM_DMABurstLength_5Bytes          ((uint16_t)0x0400)\r
 673 #define TIM_DMABurstLength_6Bytes          ((uint16_t)0x0500)\r
 674 #define TIM_DMABurstLength_7Bytes          ((uint16_t)0x0600)\r
 675 #define TIM_DMABurstLength_8Bytes          ((uint16_t)0x0700)\r
 676 #define TIM_DMABurstLength_9Bytes          ((uint16_t)0x0800)\r
 677 #define TIM_DMABurstLength_10Bytes         ((uint16_t)0x0900)\r
 678 #define TIM_DMABurstLength_11Bytes         ((uint16_t)0x0A00)\r
 679 #define TIM_DMABurstLength_12Bytes         ((uint16_t)0x0B00)\r
 680 #define TIM_DMABurstLength_13Bytes         ((uint16_t)0x0C00)\r
 681 #define TIM_DMABurstLength_14Bytes         ((uint16_t)0x0D00)\r
 682 #define TIM_DMABurstLength_15Bytes         ((uint16_t)0x0E00)\r
 683 #define TIM_DMABurstLength_16Bytes         ((uint16_t)0x0F00)\r
 684 #define TIM_DMABurstLength_17Bytes         ((uint16_t)0x1000)\r
 685 #define TIM_DMABurstLength_18Bytes         ((uint16_t)0x1100)\r
 686 #define IS_TIM_DMA_LENGTH(LENGTH) (((LENGTH) == TIM_DMABurstLength_1Byte) || \\r
 687                                    ((LENGTH) == TIM_DMABurstLength_2Bytes) || \\r
 688                                    ((LENGTH) == TIM_DMABurstLength_3Bytes) || \\r
 689                                    ((LENGTH) == TIM_DMABurstLength_4Bytes) || \\r
 690                                    ((LENGTH) == TIM_DMABurstLength_5Bytes) || \\r
 691                                    ((LENGTH) == TIM_DMABurstLength_6Bytes) || \\r
 692                                    ((LENGTH) == TIM_DMABurstLength_7Bytes) || \\r
 693                                    ((LENGTH) == TIM_DMABurstLength_8Bytes) || \\r
 694                                    ((LENGTH) == TIM_DMABurstLength_9Bytes) || \\r
 695                                    ((LENGTH) == TIM_DMABurstLength_10Bytes) || \\r
 696                                    ((LENGTH) == TIM_DMABurstLength_11Bytes) || \\r
 697                                    ((LENGTH) == TIM_DMABurstLength_12Bytes) || \\r
 698                                    ((LENGTH) == TIM_DMABurstLength_13Bytes) || \\r
 699                                    ((LENGTH) == TIM_DMABurstLength_14Bytes) || \\r
 700                                    ((LENGTH) == TIM_DMABurstLength_15Bytes) || \\r
 701                                    ((LENGTH) == TIM_DMABurstLength_16Bytes) || \\r
 702                                    ((LENGTH) == TIM_DMABurstLength_17Bytes) || \\r
 703                                    ((LENGTH) == TIM_DMABurstLength_18Bytes))\r
 704 /**\r
 705   * @}\r
 706   */ \r
 707 \r
 708 /** @defgroup TIM_DMA_sources \r
 709   * @{\r
 710   */\r
 711 \r
 712 #define TIM_DMA_Update                     ((uint16_t)0x0100)\r
 713 #define TIM_DMA_CC1                        ((uint16_t)0x0200)\r
 714 #define TIM_DMA_CC2                        ((uint16_t)0x0400)\r
 715 #define TIM_DMA_CC3                        ((uint16_t)0x0800)\r
 716 #define TIM_DMA_CC4                        ((uint16_t)0x1000)\r
 717 #define TIM_DMA_COM                        ((uint16_t)0x2000)\r
 718 #define TIM_DMA_Trigger                    ((uint16_t)0x4000)\r
 719 #define IS_TIM_DMA_SOURCE(SOURCE) ((((SOURCE) & (uint16_t)0x80FF) == 0x0000) && ((SOURCE) != 0x0000))\r
 720 \r
 721 /**\r
 722   * @}\r
 723   */ \r
 724 \r
 725 /** @defgroup TIM_External_Trigger_Prescaler \r
 726   * @{\r
 727   */\r
 728 \r
 729 #define TIM_ExtTRGPSC_OFF                  ((uint16_t)0x0000)\r
 730 #define TIM_ExtTRGPSC_DIV2                 ((uint16_t)0x1000)\r
 731 #define TIM_ExtTRGPSC_DIV4                 ((uint16_t)0x2000)\r
 732 #define TIM_ExtTRGPSC_DIV8                 ((uint16_t)0x3000)\r
 733 #define IS_TIM_EXT_PRESCALER(PRESCALER) (((PRESCALER) == TIM_ExtTRGPSC_OFF) || \\r
 734                                          ((PRESCALER) == TIM_ExtTRGPSC_DIV2) || \\r
 735                                          ((PRESCALER) == TIM_ExtTRGPSC_DIV4) || \\r
 736                                          ((PRESCALER) == TIM_ExtTRGPSC_DIV8))\r
 737 /**\r
 738   * @}\r
 739   */ \r
 740 \r
 741 /** @defgroup TIM_Internal_Trigger_Selection \r
 742   * @{\r
 743   */\r
 744 \r
 745 #define TIM_TS_ITR0                        ((uint16_t)0x0000)\r
 746 #define TIM_TS_ITR1                        ((uint16_t)0x0010)\r
 747 #define TIM_TS_ITR2                        ((uint16_t)0x0020)\r
 748 #define TIM_TS_ITR3                        ((uint16_t)0x0030)\r
 749 #define TIM_TS_TI1F_ED                     ((uint16_t)0x0040)\r
 750 #define TIM_TS_TI1FP1                      ((uint16_t)0x0050)\r
 751 #define TIM_TS_TI2FP2                      ((uint16_t)0x0060)\r
 752 #define TIM_TS_ETRF                        ((uint16_t)0x0070)\r
 753 #define IS_TIM_TRIGGER_SELECTION(SELECTION) (((SELECTION) == TIM_TS_ITR0) || \\r
 754                                              ((SELECTION) == TIM_TS_ITR1) || \\r
 755                                              ((SELECTION) == TIM_TS_ITR2) || \\r
 756                                              ((SELECTION) == TIM_TS_ITR3) || \\r
 757                                              ((SELECTION) == TIM_TS_TI1F_ED) || \\r
 758                                              ((SELECTION) == TIM_TS_TI1FP1) || \\r
 759                                              ((SELECTION) == TIM_TS_TI2FP2) || \\r
 760                                              ((SELECTION) == TIM_TS_ETRF))\r
 761 #define IS_TIM_INTERNAL_TRIGGER_SELECTION(SELECTION) (((SELECTION) == TIM_TS_ITR0) || \\r
 762                                                       ((SELECTION) == TIM_TS_ITR1) || \\r
 763                                                       ((SELECTION) == TIM_TS_ITR2) || \\r
 764                                                       ((SELECTION) == TIM_TS_ITR3))\r
 765 /**\r
 766   * @}\r
 767   */ \r
 768 \r
 769 /** @defgroup TIM_TIx_External_Clock_Source \r
 770   * @{\r
 771   */\r
 772 \r
 773 #define TIM_TIxExternalCLK1Source_TI1      ((uint16_t)0x0050)\r
 774 #define TIM_TIxExternalCLK1Source_TI2      ((uint16_t)0x0060)\r
 775 #define TIM_TIxExternalCLK1Source_TI1ED    ((uint16_t)0x0040)\r
 776 #define IS_TIM_TIXCLK_SOURCE(SOURCE) (((SOURCE) == TIM_TIxExternalCLK1Source_TI1) || \\r
 777                                       ((SOURCE) == TIM_TIxExternalCLK1Source_TI2) || \\r
 778                                       ((SOURCE) == TIM_TIxExternalCLK1Source_TI1ED))\r
 779 /**\r
 780   * @}\r
 781   */ \r
 782 \r
 783 /** @defgroup TIM_External_Trigger_Polarity \r
 784   * @{\r
 785   */ \r
 786 #define TIM_ExtTRGPolarity_Inverted        ((uint16_t)0x8000)\r
 787 #define TIM_ExtTRGPolarity_NonInverted     ((uint16_t)0x0000)\r
 788 #define IS_TIM_EXT_POLARITY(POLARITY) (((POLARITY) == TIM_ExtTRGPolarity_Inverted) || \\r
 789                                        ((POLARITY) == TIM_ExtTRGPolarity_NonInverted))\r
 790 /**\r
 791   * @}\r
 792   */\r
 793 \r
 794 /** @defgroup TIM_Prescaler_Reload_Mode \r
 795   * @{\r
 796   */\r
 797 \r
 798 #define TIM_PSCReloadMode_Update           ((uint16_t)0x0000)\r
 799 #define TIM_PSCReloadMode_Immediate        ((uint16_t)0x0001)\r
 800 #define IS_TIM_PRESCALER_RELOAD(RELOAD) (((RELOAD) == TIM_PSCReloadMode_Update) || \\r
 801                                          ((RELOAD) == TIM_PSCReloadMode_Immediate))\r
 802 /**\r
 803   * @}\r
 804   */ \r
 805 \r
 806 /** @defgroup TIM_Forced_Action \r
 807   * @{\r
 808   */\r
 809 \r
 810 #define TIM_ForcedAction_Active            ((uint16_t)0x0050)\r
 811 #define TIM_ForcedAction_InActive          ((uint16_t)0x0040)\r
 812 #define IS_TIM_FORCED_ACTION(ACTION) (((ACTION) == TIM_ForcedAction_Active) || \\r
 813                                       ((ACTION) == TIM_ForcedAction_InActive))\r
 814 /**\r
 815   * @}\r
 816   */ \r
 817 \r
 818 /** @defgroup TIM_Encoder_Mode \r
 819   * @{\r
 820   */\r
 821 \r
 822 #define TIM_EncoderMode_TI1                ((uint16_t)0x0001)\r
 823 #define TIM_EncoderMode_TI2                ((uint16_t)0x0002)\r
 824 #define TIM_EncoderMode_TI12               ((uint16_t)0x0003)\r
 825 #define IS_TIM_ENCODER_MODE(MODE) (((MODE) == TIM_EncoderMode_TI1) || \\r
 826                                    ((MODE) == TIM_EncoderMode_TI2) || \\r
 827                                    ((MODE) == TIM_EncoderMode_TI12))\r
 828 /**\r
 829   * @}\r
 830   */ \r
 831 \r
 832 \r
 833 /** @defgroup TIM_Event_Source \r
 834   * @{\r
 835   */\r
 836 \r
 837 #define TIM_EventSource_Update             ((uint16_t)0x0001)\r
 838 #define TIM_EventSource_CC1                ((uint16_t)0x0002)\r
 839 #define TIM_EventSource_CC2                ((uint16_t)0x0004)\r
 840 #define TIM_EventSource_CC3                ((uint16_t)0x0008)\r
 841 #define TIM_EventSource_CC4                ((uint16_t)0x0010)\r
 842 #define TIM_EventSource_COM                ((uint16_t)0x0020)\r
 843 #define TIM_EventSource_Trigger            ((uint16_t)0x0040)\r
 844 #define TIM_EventSource_Break              ((uint16_t)0x0080)\r
 845 #define IS_TIM_EVENT_SOURCE(SOURCE) ((((SOURCE) & (uint16_t)0xFF00) == 0x0000) && ((SOURCE) != 0x0000))\r
 846 \r
 847 /**\r
 848   * @}\r
 849   */ \r
 850 \r
 851 /** @defgroup TIM_Update_Source \r
 852   * @{\r
 853   */\r
 854 \r
 855 #define TIM_UpdateSource_Global            ((uint16_t)0x0000) /*!< Source of update is the counter overflow/underflow\r
 856                                                                    or the setting of UG bit, or an update generation\r
 857                                                                    through the slave mode controller. */\r
 858 #define TIM_UpdateSource_Regular           ((uint16_t)0x0001) /*!< Source of update is counter overflow/underflow. */\r
 859 #define IS_TIM_UPDATE_SOURCE(SOURCE) (((SOURCE) == TIM_UpdateSource_Global) || \\r
 860                                       ((SOURCE) == TIM_UpdateSource_Regular))\r
 861 /**\r
 862   * @}\r
 863   */ \r
 864 \r
 865 /** @defgroup TIM_Ouput_Compare_Preload_State \r
 866   * @{\r
 867   */\r
 868 \r
 869 #define TIM_OCPreload_Enable               ((uint16_t)0x0008)\r
 870 #define TIM_OCPreload_Disable              ((uint16_t)0x0000)\r
 871 #define IS_TIM_OCPRELOAD_STATE(STATE) (((STATE) == TIM_OCPreload_Enable) || \\r
 872                                        ((STATE) == TIM_OCPreload_Disable))\r
 873 /**\r
 874   * @}\r
 875   */ \r
 876 \r
 877 /** @defgroup TIM_Ouput_Compare_Fast_State \r
 878   * @{\r
 879   */\r
 880 \r
 881 #define TIM_OCFast_Enable                  ((uint16_t)0x0004)\r
 882 #define TIM_OCFast_Disable                 ((uint16_t)0x0000)\r
 883 #define IS_TIM_OCFAST_STATE(STATE) (((STATE) == TIM_OCFast_Enable) || \\r
 884                                     ((STATE) == TIM_OCFast_Disable))\r
 885                                      \r
 886 /**\r
 887   * @}\r
 888   */ \r
 889 \r
 890 /** @defgroup TIM_Ouput_Compare_Clear_State \r
 891   * @{\r
 892   */\r
 893 \r
 894 #define TIM_OCClear_Enable                 ((uint16_t)0x0080)\r
 895 #define TIM_OCClear_Disable                ((uint16_t)0x0000)\r
 896 #define IS_TIM_OCCLEAR_STATE(STATE) (((STATE) == TIM_OCClear_Enable) || \\r
 897                                      ((STATE) == TIM_OCClear_Disable))\r
 898 /**\r
 899   * @}\r
 900   */ \r
 901 \r
 902 /** @defgroup TIM_Trigger_Output_Source \r
 903   * @{\r
 904   */\r
 905 \r
 906 #define TIM_TRGOSource_Reset               ((uint16_t)0x0000)\r
 907 #define TIM_TRGOSource_Enable              ((uint16_t)0x0010)\r
 908 #define TIM_TRGOSource_Update              ((uint16_t)0x0020)\r
 909 #define TIM_TRGOSource_OC1                 ((uint16_t)0x0030)\r
 910 #define TIM_TRGOSource_OC1Ref              ((uint16_t)0x0040)\r
 911 #define TIM_TRGOSource_OC2Ref              ((uint16_t)0x0050)\r
 912 #define TIM_TRGOSource_OC3Ref              ((uint16_t)0x0060)\r
 913 #define TIM_TRGOSource_OC4Ref              ((uint16_t)0x0070)\r
 914 #define IS_TIM_TRGO_SOURCE(SOURCE) (((SOURCE) == TIM_TRGOSource_Reset) || \\r
 915                                     ((SOURCE) == TIM_TRGOSource_Enable) || \\r
 916                                     ((SOURCE) == TIM_TRGOSource_Update) || \\r
 917                                     ((SOURCE) == TIM_TRGOSource_OC1) || \\r
 918                                     ((SOURCE) == TIM_TRGOSource_OC1Ref) || \\r
 919                                     ((SOURCE) == TIM_TRGOSource_OC2Ref) || \\r
 920                                     ((SOURCE) == TIM_TRGOSource_OC3Ref) || \\r
 921                                     ((SOURCE) == TIM_TRGOSource_OC4Ref))\r
 922 /**\r
 923   * @}\r
 924   */ \r
 925 \r
 926 /** @defgroup TIM_Slave_Mode \r
 927   * @{\r
 928   */\r
 929 \r
 930 #define TIM_SlaveMode_Reset                ((uint16_t)0x0004)\r
 931 #define TIM_SlaveMode_Gated                ((uint16_t)0x0005)\r
 932 #define TIM_SlaveMode_Trigger              ((uint16_t)0x0006)\r
 933 #define TIM_SlaveMode_External1            ((uint16_t)0x0007)\r
 934 #define IS_TIM_SLAVE_MODE(MODE) (((MODE) == TIM_SlaveMode_Reset) || \\r
 935                                  ((MODE) == TIM_SlaveMode_Gated) || \\r
 936                                  ((MODE) == TIM_SlaveMode_Trigger) || \\r
 937                                  ((MODE) == TIM_SlaveMode_External1))\r
 938 /**\r
 939   * @}\r
 940   */ \r
 941 \r
 942 /** @defgroup TIM_Master_Slave_Mode \r
 943   * @{\r
 944   */\r
 945 \r
 946 #define TIM_MasterSlaveMode_Enable         ((uint16_t)0x0080)\r
 947 #define TIM_MasterSlaveMode_Disable        ((uint16_t)0x0000)\r
 948 #define IS_TIM_MSM_STATE(STATE) (((STATE) == TIM_MasterSlaveMode_Enable) || \\r
 949                                  ((STATE) == TIM_MasterSlaveMode_Disable))\r
 950 /**\r
 951   * @}\r
 952   */ \r
 953 \r
 954 /** @defgroup TIM_Flags \r
 955   * @{\r
 956   */\r
 957 \r
 958 #define TIM_FLAG_Update                    ((uint16_t)0x0001)\r
 959 #define TIM_FLAG_CC1                       ((uint16_t)0x0002)\r
 960 #define TIM_FLAG_CC2                       ((uint16_t)0x0004)\r
 961 #define TIM_FLAG_CC3                       ((uint16_t)0x0008)\r
 962 #define TIM_FLAG_CC4                       ((uint16_t)0x0010)\r
 963 #define TIM_FLAG_COM                       ((uint16_t)0x0020)\r
 964 #define TIM_FLAG_Trigger                   ((uint16_t)0x0040)\r
 965 #define TIM_FLAG_Break                     ((uint16_t)0x0080)\r
 966 #define TIM_FLAG_CC1OF                     ((uint16_t)0x0200)\r
 967 #define TIM_FLAG_CC2OF                     ((uint16_t)0x0400)\r
 968 #define TIM_FLAG_CC3OF                     ((uint16_t)0x0800)\r
 969 #define TIM_FLAG_CC4OF                     ((uint16_t)0x1000)\r
 970 #define IS_TIM_GET_FLAG(FLAG) (((FLAG) == TIM_FLAG_Update) || \\r
 971                                ((FLAG) == TIM_FLAG_CC1) || \\r
 972                                ((FLAG) == TIM_FLAG_CC2) || \\r
 973                                ((FLAG) == TIM_FLAG_CC3) || \\r
 974                                ((FLAG) == TIM_FLAG_CC4) || \\r
 975                                ((FLAG) == TIM_FLAG_COM) || \\r
 976                                ((FLAG) == TIM_FLAG_Trigger) || \\r
 977                                ((FLAG) == TIM_FLAG_Break) || \\r
 978                                ((FLAG) == TIM_FLAG_CC1OF) || \\r
 979                                ((FLAG) == TIM_FLAG_CC2OF) || \\r
 980                                ((FLAG) == TIM_FLAG_CC3OF) || \\r
 981                                ((FLAG) == TIM_FLAG_CC4OF))\r
 982                                \r
 983                                \r
 984 #define IS_TIM_CLEAR_FLAG(TIM_FLAG) ((((TIM_FLAG) & (uint16_t)0xE100) == 0x0000) && ((TIM_FLAG) != 0x0000))\r
 985 /**\r
 986   * @}\r
 987   */ \r
 988 \r
 989 /** @defgroup TIM_Input_Capture_Filer_Value \r
 990   * @{\r
 991   */\r
 992 \r
 993 #define IS_TIM_IC_FILTER(ICFILTER) ((ICFILTER) <= 0xF) \r
 994 /**\r
 995   * @}\r
 996   */ \r
 997 \r
 998 /** @defgroup TIM_External_Trigger_Filter \r
 999   * @{\r
1000   */\r
1001 \r
1002 #define IS_TIM_EXT_FILTER(EXTFILTER) ((EXTFILTER) <= 0xF)\r
1003 /**\r
1004   * @}\r
1005   */ \r
1006 \r
1007 /**\r
1008   * @}\r
1009   */\r
1010 \r
1011 /** @defgroup TIM_Exported_Macros\r
1012   * @{\r
1013   */\r
1014 \r
1015 /**\r
1016   * @}\r
1017   */ \r
1018 \r
1019 /** @defgroup TIM_Exported_Functions\r
1020   * @{\r
1021   */\r
1022 \r
1023 void TIM_DeInit(TIM_TypeDef* TIMx);\r
1024 void TIM_TimeBaseInit(TIM_TypeDef* TIMx, TIM_TimeBaseInitTypeDef* TIM_TimeBaseInitStruct);\r
1025 void TIM_OC1Init(TIM_TypeDef* TIMx, TIM_OCInitTypeDef* TIM_OCInitStruct);\r
1026 void TIM_OC2Init(TIM_TypeDef* TIMx, TIM_OCInitTypeDef* TIM_OCInitStruct);\r
1027 void TIM_OC3Init(TIM_TypeDef* TIMx, TIM_OCInitTypeDef* TIM_OCInitStruct);\r
1028 void TIM_OC4Init(TIM_TypeDef* TIMx, TIM_OCInitTypeDef* TIM_OCInitStruct);\r
1029 void TIM_ICInit(TIM_TypeDef* TIMx, TIM_ICInitTypeDef* TIM_ICInitStruct);\r
1030 void TIM_PWMIConfig(TIM_TypeDef* TIMx, TIM_ICInitTypeDef* TIM_ICInitStruct);\r
1031 void TIM_BDTRConfig(TIM_TypeDef* TIMx, TIM_BDTRInitTypeDef *TIM_BDTRInitStruct);\r
1032 void TIM_TimeBaseStructInit(TIM_TimeBaseInitTypeDef* TIM_TimeBaseInitStruct);\r
1033 void TIM_OCStructInit(TIM_OCInitTypeDef* TIM_OCInitStruct);\r
1034 void TIM_ICStructInit(TIM_ICInitTypeDef* TIM_ICInitStruct);\r
1035 void TIM_BDTRStructInit(TIM_BDTRInitTypeDef* TIM_BDTRInitStruct);\r
1036 void TIM_Cmd(TIM_TypeDef* TIMx, FunctionalState NewState);\r
1037 void TIM_CtrlPWMOutputs(TIM_TypeDef* TIMx, FunctionalState NewState);\r
1038 void TIM_ITConfig(TIM_TypeDef* TIMx, uint16_t TIM_IT, FunctionalState NewState);\r
1039 void TIM_GenerateEvent(TIM_TypeDef* TIMx, uint16_t TIM_EventSource);\r
1040 void TIM_DMAConfig(TIM_TypeDef* TIMx, uint16_t TIM_DMABase, uint16_t TIM_DMABurstLength);\r
1041 void TIM_DMACmd(TIM_TypeDef* TIMx, uint16_t TIM_DMASource, FunctionalState NewState);\r
1042 void TIM_InternalClockConfig(TIM_TypeDef* TIMx);\r
1043 void TIM_ITRxExternalClockConfig(TIM_TypeDef* TIMx, uint16_t TIM_InputTriggerSource);\r
1044 void TIM_TIxExternalClockConfig(TIM_TypeDef* TIMx, uint16_t TIM_TIxExternalCLKSource,\r
1045                                 uint16_t TIM_ICPolarity, uint16_t ICFilter);\r
1046 void TIM_ETRClockMode1Config(TIM_TypeDef* TIMx, uint16_t TIM_ExtTRGPrescaler, uint16_t TIM_ExtTRGPolarity,\r
1047                              uint16_t ExtTRGFilter);\r
1048 void TIM_ETRClockMode2Config(TIM_TypeDef* TIMx, uint16_t TIM_ExtTRGPrescaler, \r
1049                              uint16_t TIM_ExtTRGPolarity, uint16_t ExtTRGFilter);\r
1050 void TIM_ETRConfig(TIM_TypeDef* TIMx, uint16_t TIM_ExtTRGPrescaler, uint16_t TIM_ExtTRGPolarity,\r
1051                    uint16_t ExtTRGFilter);\r
1052 void TIM_PrescalerConfig(TIM_TypeDef* TIMx, uint16_t Prescaler, uint16_t TIM_PSCReloadMode);\r
1053 void TIM_CounterModeConfig(TIM_TypeDef* TIMx, uint16_t TIM_CounterMode);\r
1054 void TIM_SelectInputTrigger(TIM_TypeDef* TIMx, uint16_t TIM_InputTriggerSource);\r
1055 void TIM_EncoderInterfaceConfig(TIM_TypeDef* TIMx, uint16_t TIM_EncoderMode,\r
1056                                 uint16_t TIM_IC1Polarity, uint16_t TIM_IC2Polarity);\r
1057 void TIM_ForcedOC1Config(TIM_TypeDef* TIMx, uint16_t TIM_ForcedAction);\r
1058 void TIM_ForcedOC2Config(TIM_TypeDef* TIMx, uint16_t TIM_ForcedAction);\r
1059 void TIM_ForcedOC3Config(TIM_TypeDef* TIMx, uint16_t TIM_ForcedAction);\r
1060 void TIM_ForcedOC4Config(TIM_TypeDef* TIMx, uint16_t TIM_ForcedAction);\r
1061 void TIM_ARRPreloadConfig(TIM_TypeDef* TIMx, FunctionalState NewState);\r
1062 void TIM_SelectCOM(TIM_TypeDef* TIMx, FunctionalState NewState);\r
1063 void TIM_SelectCCDMA(TIM_TypeDef* TIMx, FunctionalState NewState);\r
1064 void TIM_CCPreloadControl(TIM_TypeDef* TIMx, FunctionalState NewState);\r
1065 void TIM_OC1PreloadConfig(TIM_TypeDef* TIMx, uint16_t TIM_OCPreload);\r
1066 void TIM_OC2PreloadConfig(TIM_TypeDef* TIMx, uint16_t TIM_OCPreload);\r
1067 void TIM_OC3PreloadConfig(TIM_TypeDef* TIMx, uint16_t TIM_OCPreload);\r
1068 void TIM_OC4PreloadConfig(TIM_TypeDef* TIMx, uint16_t TIM_OCPreload);\r
1069 void TIM_OC1FastConfig(TIM_TypeDef* TIMx, uint16_t TIM_OCFast);\r
1070 void TIM_OC2FastConfig(TIM_TypeDef* TIMx, uint16_t TIM_OCFast);\r
1071 void TIM_OC3FastConfig(TIM_TypeDef* TIMx, uint16_t TIM_OCFast);\r
1072 void TIM_OC4FastConfig(TIM_TypeDef* TIMx, uint16_t TIM_OCFast);\r
1073 void TIM_ClearOC1Ref(TIM_TypeDef* TIMx, uint16_t TIM_OCClear);\r
1074 void TIM_ClearOC2Ref(TIM_TypeDef* TIMx, uint16_t TIM_OCClear);\r
1075 void TIM_ClearOC3Ref(TIM_TypeDef* TIMx, uint16_t TIM_OCClear);\r
1076 void TIM_ClearOC4Ref(TIM_TypeDef* TIMx, uint16_t TIM_OCClear);\r
1077 void TIM_OC1PolarityConfig(TIM_TypeDef* TIMx, uint16_t TIM_OCPolarity);\r
1078 void TIM_OC1NPolarityConfig(TIM_TypeDef* TIMx, uint16_t TIM_OCNPolarity);\r
1079 void TIM_OC2PolarityConfig(TIM_TypeDef* TIMx, uint16_t TIM_OCPolarity);\r
1080 void TIM_OC2NPolarityConfig(TIM_TypeDef* TIMx, uint16_t TIM_OCNPolarity);\r
1081 void TIM_OC3PolarityConfig(TIM_TypeDef* TIMx, uint16_t TIM_OCPolarity);\r
1082 void TIM_OC3NPolarityConfig(TIM_TypeDef* TIMx, uint16_t TIM_OCNPolarity);\r
1083 void TIM_OC4PolarityConfig(TIM_TypeDef* TIMx, uint16_t TIM_OCPolarity);\r
1084 void TIM_CCxCmd(TIM_TypeDef* TIMx, uint16_t TIM_Channel, uint16_t TIM_CCx);\r
1085 void TIM_CCxNCmd(TIM_TypeDef* TIMx, uint16_t TIM_Channel, uint16_t TIM_CCxN);\r
1086 void TIM_SelectOCxM(TIM_TypeDef* TIMx, uint16_t TIM_Channel, uint16_t TIM_OCMode);\r
1087 void TIM_UpdateDisableConfig(TIM_TypeDef* TIMx, FunctionalState NewState);\r
1088 void TIM_UpdateRequestConfig(TIM_TypeDef* TIMx, uint16_t TIM_UpdateSource);\r
1089 void TIM_SelectHallSensor(TIM_TypeDef* TIMx, FunctionalState NewState);\r
1090 void TIM_SelectOnePulseMode(TIM_TypeDef* TIMx, uint16_t TIM_OPMode);\r
1091 void TIM_SelectOutputTrigger(TIM_TypeDef* TIMx, uint16_t TIM_TRGOSource);\r
1092 void TIM_SelectSlaveMode(TIM_TypeDef* TIMx, uint16_t TIM_SlaveMode);\r
1093 void TIM_SelectMasterSlaveMode(TIM_TypeDef* TIMx, uint16_t TIM_MasterSlaveMode);\r
1094 void TIM_SetCounter(TIM_TypeDef* TIMx, uint16_t Counter);\r
1095 void TIM_SetAutoreload(TIM_TypeDef* TIMx, uint16_t Autoreload);\r
1096 void TIM_SetCompare1(TIM_TypeDef* TIMx, uint16_t Compare1);\r
1097 void TIM_SetCompare2(TIM_TypeDef* TIMx, uint16_t Compare2);\r
1098 void TIM_SetCompare3(TIM_TypeDef* TIMx, uint16_t Compare3);\r
1099 void TIM_SetCompare4(TIM_TypeDef* TIMx, uint16_t Compare4);\r
1100 void TIM_SetIC1Prescaler(TIM_TypeDef* TIMx, uint16_t TIM_ICPSC);\r
1101 void TIM_SetIC2Prescaler(TIM_TypeDef* TIMx, uint16_t TIM_ICPSC);\r
1102 void TIM_SetIC3Prescaler(TIM_TypeDef* TIMx, uint16_t TIM_ICPSC);\r
1103 void TIM_SetIC4Prescaler(TIM_TypeDef* TIMx, uint16_t TIM_ICPSC);\r
1104 void TIM_SetClockDivision(TIM_TypeDef* TIMx, uint16_t TIM_CKD);\r
1105 uint16_t TIM_GetCapture1(TIM_TypeDef* TIMx);\r
1106 uint16_t TIM_GetCapture2(TIM_TypeDef* TIMx);\r
1107 uint16_t TIM_GetCapture3(TIM_TypeDef* TIMx);\r
1108 uint16_t TIM_GetCapture4(TIM_TypeDef* TIMx);\r
1109 uint16_t TIM_GetCounter(TIM_TypeDef* TIMx);\r
1110 uint16_t TIM_GetPrescaler(TIM_TypeDef* TIMx);\r
1111 FlagStatus TIM_GetFlagStatus(TIM_TypeDef* TIMx, uint16_t TIM_FLAG);\r
1112 void TIM_ClearFlag(TIM_TypeDef* TIMx, uint16_t TIM_FLAG);\r
1113 ITStatus TIM_GetITStatus(TIM_TypeDef* TIMx, uint16_t TIM_IT);\r
1114 void TIM_ClearITPendingBit(TIM_TypeDef* TIMx, uint16_t TIM_IT);\r
1115 \r
1116 #ifdef __cplusplus\r
1117 }\r
1118 #endif\r
1119 \r
1120 #endif /*__STM32F10x_TIM_H */\r
1121 /**\r
1122   * @}\r
1123   */ \r
1124 \r
1125 /**\r
1126   * @}\r
1127   */ \r
1128 \r
1129 /**\r
1130   * @}\r
1131   */\r
1132 \r
1133 /******************* (C) COPYRIGHT 2010 STMicroelectronics *****END OF FILE****/\r